CREA: Colección de Recursos Educativos Abiertos

 

Arquitectura de computadores : prácticas con RISC-V

dc.audience.coursArquitectura de computadoreses_ES
dc.audience.degreeGrado en Ingeniería Informáticaes_ES
dc.audience.degreeMáster Universitario en Ingeniería Informáticaes_ES
dc.audience.levelGradoes_ES
dc.audience.mediatorUniversidad de Jaén. Escuela Politécnica Superior (Jaén)es_ES
dc.contributor.authorCharte Ojeda, Francisco
dc.contributor.otherUniversidad de Jaén. Informáticaes_ES
dc.date.accessioned2024-10-08T10:38:56Z
dc.date.available2024-10-08T10:38:56Z
dc.date.issued2024-09
dc.description.abstractEste manual está dirigido a estudiantes de la asignatura Arquitectura de computadores (o equivalente) y, en general, a cualquiera interesado en la programación en ensamblador de un procesador con ISA (Instruction Set Architecture) RISC-V. Se abordan los modos de direccionamiento de dicha ISA y su conjunto de instrucciones, así como el estudio de técnicas comunes de optimización como son el reordenamiento de código (para evitar riesgos de datos), desenrollado de bucles (para reducir riesgos de control), cauces superescalares y configuración adecuada de la memoria caché. La herramienta utilizada en el manual es el simulador Ripes.es_ES
dc.format.mimetypeapplication/pdf
dc.identifier.urihttps://hdl.handle.net/10953.1/25108
dc.language.isospaes_ES
dc.rightsAtribución-NoComercial-CompartirIgual 3.0 España*
dc.rights.accessRightsinfo:eu-repo/semantics/openAccesses_ES
dc.rights.urihttp://creativecommons.org/licenses/by-nc-sa/3.0/es/*
dc.subjectArquitectura de computadoreses_ES
dc.subjectEnsambladores_ES
dc.subjectRISC-Ves_ES
dc.subject.unescoCiencias Tecnológicas (33)es_ES
dc.titleArquitectura de computadores : prácticas con RISC-Ves_ES
dc.typeinfo:eu-repo/semantics/learningObjectes_ES
lom.learningresourcetypeApuntes, manuales y presentacioneses_ES
lom.methodofinstruction.instructionalmethoddifficultyNo Aplicablees_ES
lom.methodofinstruction.instructionalmethodinteractivitylevelNo Aplicablees_ES

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